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+ | Le premier jet du HDL est écrit en Verilog, mais une version définitive est prévue en [https://github.com/SpinalHDL SpinalHDL]. Cette première version ne contient pas de softcore, il s'agit juste d'une FSM récupérant les commandes venant de l'USB et pilotant les PLL et l'ADC. | ||
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== Entrées Analogiques == | == Entrées Analogiques == |
Revision as of 00:36, 2 February 2018
Contents
VNA Baseband 2-12GHz
Le but de ce projet est de réutiliser certains vieux testset de VNA (notamment ceux présents dans la baie R&S). La carte vise à remplacer les unités d'affichage et de calculateur. Seul les coupleurs/pont de reflectométrie sont gardés. La carte embarque aussi les PLL nécessaires pour remplacer les générateurs de balayage.
La documentation de ce projet se découpe en différente partie, d'abord une partie diagramme avec explications détaillées et enfin les fichiers de fabrication (kicad) avec le code FPGA et PC.
Le git sera bientôt migré sur celui de l'electrolab.
Détails d'architecture
Partie Numérique
La partie numérique est somme toute relativement classique, il s'agit d'un [Spartan 6] de Xilinx (sera sans doute remplacé par un Spartan 7 à terme) accompagné d'un [FT2232H] de FTDI. Le FT2232H est utilisé en mode FT245 Synchrone. Les contraintes de latence et de débit instantané sont assez faible dans l'usage prévu, en effet l'acquisition des échantillons se fait à la demande par paquet. Une architecture différente sera nécessaire si il est envisagé d'utiliser la carte comme un récepteur radio 2 à 12GHz.
Le premier jet du HDL est écrit en Verilog, mais une version définitive est prévue en SpinalHDL. Cette première version ne contient pas de softcore, il s'agit juste d'une FSM récupérant les commandes venant de l'USB et pilotant les PLL et l'ADC.